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2025. 4. 7. 16:26·HDLBits/Circuits

요구사항이 negedge clk와 reset시에 0x34를 넣으라는 문제

module top_module (
    input clk,
    input reset,
    input [7:0] d,
    output [7:0] q
);

    always @(negedge clk)begin
        if(reset) q <= 8'h34;
        else q <= d;
    end

endmodule
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