HDLBits - Notgate

2024. 12. 5. 18:30·HDLBits/Verilog

https://hdlbits.01xz.net/wiki/Notgate

단순히 NOT Gate를 사용하여 inverse 시키는 문제

module top_module(
    input in,
    output out
);

    assign out = ~in;

endmodule
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